Name: Vhdl – Lenguaje para Síntesis y Modelado de Circuitos
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Author: Fernando Pardo, José Boluda
ISBN: 9786077071747

portada Vhdl – Lenguaje para Síntesis y Modelado de Circuitos

Vhdl – Lenguaje para Síntesis y Modelado de Circuitos

Formato

Libro Físico

Editorial

Alfaomega Grupo Editor

Autor

Fernando Pardo, José Boluda

Categoría

Ingeniería eléctrica y electrónica

Año

2011

Idioma

Español

N° páginas

308

Encuadernación

Tapa Blanda

Dimensiones

24x18 cm

ISBN

6077071749

ISBN13

9786077071747

Editado en

México

N° edición

Vhdl – Lenguaje para Síntesis y Modelado de Circuitos

Fernando Pardo, José Boluda (Autor) · Alfaomega Grupo Editor · Tapa Blanda

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Reseña del libro "Vhdl – Lenguaje para Síntesis y Modelado de Circuitos"

El objetivo de este libro no es únicamente el de presentar el lenguaje y su sintaxis, sino también el de introducir la metodología de trabajo inherente al lenguaje, ya que se trata del flujo de diseño actual de circuitos digitales. Además, se centra en las dos grandes áreas de aplicación del VHDL: la simulación y la síntesis automática de circuitos.

La estructura y contenido de esta obra están basados en varios años de experiencia en la enseñanza del VHDL y diseño digital, por lo que el principal objetivo perseguido por los autores es su carácter didáctico y pedagógico, sin olvidar que también va dirigido a los ingenieros que actualmente empiezan a incorporar estas técnicas de diseño a su entorno laboral. En esta tercera edición se han añadido nuevos elementos del lenguaje y ejemplos para dar cobertura a los importantes cambios y mejoras introducidos en el estándar de VHDL 2008. También se han incorporado los últimos avances en dispositivos de lógica programable, pues sigue siendo un área de fuerte evolución y cambio.